再谈数字锁相环

数字锁相环

    模拟锁相环路（ APLL）已在模拟和数字通信已经无线电电子学领域获得极为广泛的应用。随着大规模、超高速数字集成电路的发展以及计算机的普及运用，为研究和制作全数字锁相环路（ ADPLL）提供了极为有利的条件。数字锁相环是在模拟锁相环的基础上发展起来的。开始，只是把模拟环路的部分数字化，后来才出现了全数字锁相环路。所谓全数字化，就是环路部件数字化，采用数字鉴相器（ DPD）、数字环路滤波器（ DLF）、数控振荡器（ DCO）构成的锁相环。目前，全数字锁相环路的研究日趋成熟，并已制成全数字化锁相环路FSK 信号解调器、PSK 信号解调器、位时钟提取器及同步载波提取器等。全数字化锁相环的共同特点是：
    1. 数字锁相环电路完全数字化，使用逻辑门电路和触发器电路。系统中只有“ 导通”和“ 截止” 两种工作状态，受外界和电源的干扰的可能性大大减小，电路容易集成，易于制成全集成化的单片全数字锁相环路。因而系统的可靠性大大提高。
    2. 全数字锁相环路还缓和或消除了模拟锁相环路中电压控制振荡器（ VCO）的非线性以及环路中使用运算放大器和晶体管后而出现的饱和及运算放大器和鉴相器的零漂等对环路性能的影响。
    3. 数字锁相环路的环路部件甚至整个环路都可以直接用微处理机来模拟实现。
    4. 全数字锁相环路中，因模拟量转变为数字量所引入的量化误差和离散控制造成的误差，只要系统设计得当，均可以被忽略。

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本文刊于：2010-10-1 21:14:11

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